不必要なメモリバリアを追加すると、プロデューサー/コンシューマーキューでのアトミック操作の可視性パフォーマンスが向上しますか?

ハードウェア メモリ バリアはアトミック操作の可視性パフォーマンスを向上させますか?

質問:

プロデューサー/コンシューマー キュー。不要なメモリ フェンスを追加したり、メモリ順序を強化したりすることで、可視性を向上させることができます。アトミックオペレーション？もしそうなら、フェンスがある場合とない場合のレイテンシの違いは何ですか?

答え:

コア間レイテンシへの影響:

• メモリフェンスはストアのコア間レイテンシに大きな影響を与えない

ストア バッファの動作:

• CPU ストア バッファは、キャッシュへの書き込みをできるだけ早くコミットするように設計されています。フェンスは現在のコアにストアの完了を待機させるだけであり、フェンスがなければ最終的にはそうなります。

潜在的な二次的影響:

• フェンスは次の可能性があります。後のロードをブロックし、キャッシュ ラインの無効化を促進することで、軽度の副次的影響があり、他のコアでの後続のロードに対するミス ペナルティが軽減される可能性があります。ただし、これらの影響は重要ではありません。

負荷パフォーマンス:

• CPU は、他のメモリ アクセスよりも要求負荷を優先します。一般に、ロードの前後にバリアを追加してもパフォーマンスは向上しません。

結論:

ほとんどの場合、不要なフェンスやより強力なメモリ順序を追加しても、可視性は向上しません。パフォーマンス。ポインタの追跡や高負荷のトラフィックなど、非常に特殊な状況でのみ、ほとんどメリットが得られない可能性があります。最適な戦略を決定するには、経験に基づくプロファイリングをお勧めします。

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