Selon les informations de ce site Web du 23 juillet, le média coréen The Elec a rapporté le 17 de ce mois que le processus avancé de 2 nm que Samsung Electronics devrait lancer l'année prochaine augmentera le nombre de couches d'exposition EUV de plus de 30 % par rapport à le processus 3 nm existant, atteignant « 20 ~ Le milieu et la seconde moitié de 30. » Les médias coréens ont mentionné dans le rapport que selon la nature du produit, même le nombre de couches exposées au même nœud n'est pas complètement fixé. Cependant, dans l'ensemble, le nombre moyen de couches d'exposition EUV dans le procédé 3 nm de Samsung Electronics n'est que de 20 ; dans le procédé SF1.4, qui devrait être produit en série en 2027, le nombre de couches d'exposition EUV devrait dépasser 30 ; couches.
▲ Machine de lithographie EUV 0,33NA nouvelle génération d'ASML NXE:3800E Avec l'évolution des processus avancés, les exigences en matière de taille de transistor sont devenues de plus en plus strictes. L'utilisation de la lithographie EUV pour remplacer le DUV traditionnel dans la couche d'exposition permet d'obtenir une précision de lithographie plus élevée, d'augmenter encore la densité des transistors et d'accueillir davantage de circuits intégrés par unité de surface.
Dans ce contexte, les entreprises de fonderie de logique avancée achètent activement les machines EUV d'ASML.
Prenons TSMC comme exemple. Selon les rapports précédents sur ce site, il recevra un total de plus de 60 machines de lithographie EUV cette année et l'année prochaine. Les médias coréens estiment que TSMC disposera de plus de 160 machines de lithographie EUV d'ici fin 2025.
De plus, l'utilisation de la lithographie EUV dans l'industrie de la mémoire DRAM augmente également :
Sur le processus de sixième génération de niveau 20~10 nm (c'est-à-dire 1c nm, 1γ nm), Samsung Electronics utilise 6~7 couches EUV et SK Hynix utilise 5 couches EUV, Micron a également introduit la lithographie EUV pour la première fois à ce nœud.
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